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24AA32A/24LC32A
FIGURE 8-2:
RANDOM READ
Bus Activity
Master
S
T
A
R
T
Control
Byte
Address
High Byte
Address
Low Byte
S
T
A
R
T
Control
Byte
Data
Byte
S
T
O
P
S 1 0 1 0 A 1 0 A 0 x x x x
SDA Line
S 1 0 1 0 A A A 1
x = “don’t care” bit
2
A
A
Bus Activity C
K
A
C
K
A
C
K
210
A
C
K
N
O
A
C
K
P
FIGURE 8-3:
SEQUENTIAL READ
Bus Activity
Master
Control
Byte
Data n
Data n + 1
Data n + 2
Data n + x
S
T
O
P
SDA Line
P
Bus Activity
A
C
K
A
C
K
A
C
K
A
C
K
N
O
A
C
K
DS21713M-page 12
? 2002-2012 Microchip Technology Inc.
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